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書名

SystemVerilogによるFPGA/ディジタル回路設計入門     

著者名 小林 和淑/監修
著者名ヨミ コバヤシ カズトシ
出版者 オーム社
出版年月 2023.11


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小林 和淑 小林 和淑 寺澤 真一 吉河 武文 塩見 準 門本 淳一郎
2023
549.7 549.7
集積回路 ハードウェア記述言語

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No. 所蔵館 資料番号 請求番号 配架場所 資料種別 帯出区分 貸出
1 高輪図書館0513470120549.7/シ/開架一般和書 

書誌詳細

この資料の書誌詳細情報です。

タイトルコード 1000002272171
書誌種別 図書
著者名 小林 和淑/監修   小林 和淑/共著   寺澤 真一/共著   吉河 武文/共著   塩見 準/共著   門本 淳一郎/共著
著者名ヨミ コバヤシ カズトシ コバヤシ カズトシ テラサワ シンイチ ヨシカワ タケフミ シオミ ジュン カドモト ジュンイチロウ
出版者 オーム社
出版年月 2023.11
ページ数 8,183p
大きさ 24cm
ISBN 4-274-23101-8
分類記号 549.7
書名 SystemVerilogによるFPGA/ディジタル回路設計入門     
書名ヨミ システム ヴェリログ ニ ヨル エフピージーエー ディジタル カイロ セッケイ ニュウモン 
内容紹介 HDLは、高い抽象度でハードウェアの動作を記述することを目的に開発された。順序同期回路をSystemVerilogで記述し、LSIやFPGAに実装したい設計者向けに、設計事例をもとに解説する。
本体価格 ¥3000
一般件名 集積回路 ハードウェア記述言語



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